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C8051T610/1/2/3/4/5/6/7
C2CK/RST
Power On
Reset
Reset
Debug /
Programming
Hardware
C2D
CIP-51 8051
Controller Core
8/16 k Byte EPROM
Program Memory
256 byte SRAM
1 k Byte XRAM
Port I/O Configuration
Digital Peripherals
UART
Timers 0,
1, 2, 3
Priority
Crossbar
PCA/
Decoder
WDT
Port 0
Drivers
P0.0/VREF
P0.1
P0.2/VPP
P0.3/EXTCLK
P0.4/TX
P0.5/RX
P0.6/CNVSTR
P0.7
P1.0
SMBus
P1.1
P1.2
SPI
Port 1
P1.3
VDD
GND
Peripheral Power
Regulator
Core Power
SYSCLK
SFR
Bus
Crossbar Control
Analog Peripherals
CP0
+
-
CP1
+
-
Drivers
Port 2
P1.4
P1.5
P1.6
P1.7
P2.0
P2.1
P2.2
P2.3
Comparators
Drivers
P2.4
VDD
VREF
P2.5
P2.6
10-bit
ADC
Temp
EXTCLK
External Precision
Clock Internal
Circuit Oscillator
System Clock
Configuration
VDD
A
M
500 ksps
U
X
Sensor
C8051T610/2 Only
Port 3
Drivers
P2.7
P3.0/C2D
P3.1
P3.2
P3.3
P3.4
Figure 1.1. C8051T610/2/4 Block Diagram (32-pin LQFP)
16
Rev 1.1
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